Warum muss ich VHDL-Komponenten neu deklarieren, bevor ich sie in anderen Architekturen instanziiere?

Ich habe mir seit meiner ersten VHDL-Klasse den Kopf zerkratzt und beschlossen, meine Frage hier zu posten.

Da ich eine deklarierte Entität (und auch eine Architektur davon) habe und sie in einer anderen Architektur instanziieren möchte, warum muss ich anscheinend die "Entität" (Komponente) in dieser enthaltenen Architektur neu deklarieren, bevor ich sie instanziiere?

Ist der Compiler nicht intelligent genug, um eine Instanziierung nur anhand ihres Namens ihrer Architektur zuzuordnen? Wo ist die Komponentendeklaration erforderlich?

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